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ZFTurbo / Verilog-Generator-of-Neural-Net-Digit-Detector-for-FPGA

Verilog Generator of Neural Net Digit Detector for FPGA
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改变结构 #8

Open xw2333 opened 5 years ago

xw2333 commented 5 years ago

请问我如果改变网络的层数，比如再加一层卷积层，那么生成的verilog代码还能够正常工作吗？我试了发现无法工作。