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在单处理结构中，只要能保证在CS操作中不会发生进程调度，并且不会发生中断，或者即使发生了中断也与操作的对象无关，就保证了操作的互斥性。即使不允许关中断，只要CS的操作在单条指令中完成，那也保证了互斥，因为中断只发生于指令之间，而不会发生在执行一条指令的中途
中断只发生于指令之间，而不会发生在执行一条指令的中途
CPU有MTRR，用以控制使不使用缓冲，cache 模式是什么。Pentium 以前的处理器没有MTRR
首先单纯的读写就是原子的，不管8b,16b,32b，都只要一个内存读写微操作完成，所以是不可分割的？？ 一些特殊的指令起着barrier 的作用，如iret, cpuid, sfence
9 SMP 系统结构
在单处理结构中，只要能保证在CS操作中不会发生进程调度，并且不会发生中断，或者即使发生了中断也与操作的对象无关，就保证了操作的互斥性。即使不允许关中断，只要CS的操作在单条指令中完成，那也保证了互斥，因为
中断只发生于指令之间，而不会发生在执行一条指令的中途CPU有MTRR，用以控制使不使用缓冲，cache 模式是什么。Pentium 以前的处理器没有MTRR
首先单纯的读写就是原子的，不管8b,16b,32b，都只要一个内存读写微操作完成，所以是不可分割的？？ 一些特殊的指令起着barrier 的作用，如iret, cpuid, sfence