search

halftop / halftop.github.io

https://halftop.github.io
2 stars 0 forks source link

Verilog没有葵花宝典——day6（边沿检测） | 1/2顶点 #14

Open halftop opened 5 years ago

halftop commented 5 years ago

https://halftop.github.io/post/verilog-day6/

有输入有输出，才是正确的学习方式。