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各トランザクションに設定した(弱い)分離レベルの組み合わせで直列化可能性を達成する多項式時間のアルゴリズムを提案。与えられたトランザクションの集合に対してその各トランザクションの分離レベルをSSIからRCやSIに変更して直列化可能性を満たすかどうかを検証。
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各トランザクションに設定した(弱い)分離レベルの組み合わせで直列化可能性を達成する多項式時間のアルゴリズムを提案。与えられたトランザクションの集合に対してその各トランザクションの分離レベルをSSIからRCやSIに変更して直列化可能性を満たすかどうかを検証。